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CS35L41_OTP_TRIM_32 0x00007434 #define CS35L41_OTP_TRIM_33 0x00007068 #define CS35L41_OTP_TRIM_34 0x0000410C #define CS35L41_OTP_TRIM_35 0x0000400C #define CS35L41_OTP_TRIM_36 0x00002030 #define CS35L41_MAX_CACHE_REG 36 #define CS35L41_OTP_SIZE_WORDS 32 #define CS35L41_NUM_SUPPLIES 2 #define CS35L41_SCLK_MSTR_MASK 0x10 #define CS35L41_SCLK_MSTR_SHIFT 4 #define CS35L41_LRCLK_MSTR_MASK 0x01 #define CS35L41_LRCLK_MSTR_SHIFT 0 #define CS35L41_SCLK_INV_MASK 0x40 #define CS35L41_SCLK_INV_SHIFT 6 #define CS35L41_LRCLK_INV_MASK 0x04 #define CS35L41_LRCLK_INV_SHIFT 2 #define CS35L41_SCLK_FRC_MASK 0x20 #define CS35L41_SCLK_FRC_SHIFT 5 #define CS35L41_LRCLK_FRC_MASK 0x02 #define CS35L41_LRCLK_FRC_SHIFT 1 #define CS35L41_AMP_GAIN_PCM_MASK 0x3E0 #define CS35L41_AMP_GAIN_ZC_MASK 0x0400 #define CS35L41_AMP_GAIN_ZC_SHIFT 10 #define CS35L41_BST_CTL_MASK 0xFF #define CS35L41_BST_CTL_SEL_MASK 0x03 #define CS35L41_BST_CTL_SEL_REG 0x00 #define CS35L41_BST_CTL_SEL_CLASSH 0x01 #define CS35L41_BST_IPK_MASK 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enum cs35l41_boost_type { CS35L41_INT_BOOST, CS35L41_EXT_BOOST, CS35L41_SHD_BOOST_ACTV, CS35L41_SHD_BOOST_PASS, // Not present in Binding Documentation, so no system should use this value. // This value is only used in CLSA0100 Laptop CS35L41_EXT_BOOST_NO_VSPK_SWITCH, }; enum cs35l41_clk_ids { CS35L41_CLKID_SCLK = 0, CS35L41_CLKID_LRCLK = 1, CS35L41_CLKID_MCLK = 4, }; enum cs35l41_gpio1_func { CS35L41_GPIO1_HIZ, CS35L41_GPIO1_GPIO, CS35L41_GPIO1_MDSYNC, CS35L41_GPIO1_MCLK, CS35L41_GPIO1_PDM_CLK, CS35L41_GPIO1_PDM_DATA, }; enum cs35l41_gpio2_func { CS35L41_GPIO2_HIZ, CS35L41_GPIO2_GPIO, CS35L41_GPIO2_INT_OPEN_DRAIN, CS35L41_GPIO2_MCLK, CS35L41_GPIO2_INT_PUSH_PULL_LOW, CS35L41_GPIO2_INT_PUSH_PULL_HIGH, CS35L41_GPIO2_PDM_CLK, CS35L41_GPIO2_PDM_DATA, }; struct cs35l41_gpio_cfg { bool valid; bool pol_inv; bool out_en; unsigned int func; }; struct cs35l41_hw_cfg { bool valid; int bst_ind; int bst_ipk; int bst_cap; int dout_hiz; struct cs35l41_gpio_cfg gpio1; struct cs35l41_gpio_cfg gpio2; unsigned int spk_pos; enum cs35l41_boost_type bst_type; }; struct cs35l41_otp_packed_element_t { u32 reg; u8 shift; u8 size; }; struct cs35l41_otp_map_element_t { u32 id; u32 num_elements; const struct cs35l41_otp_packed_element_t *map; u32 bit_offset; u32 word_offset; }; enum cs35l41_cspl_mbox_status { CSPL_MBOX_STS_ERROR = U32_MAX, CSPL_MBOX_STS_ERROR2 = 0x00ffffff, // firmware not always sign-extending 24-bit value CSPL_MBOX_STS_RUNNING = 0, CSPL_MBOX_STS_PAUSED = 1, CSPL_MBOX_STS_RDY_FOR_REINIT = 2, }; enum cs35l41_cspl_mbox_cmd { CSPL_MBOX_CMD_NONE = 0, CSPL_MBOX_CMD_PAUSE = 1, CSPL_MBOX_CMD_RESUME = 2, CSPL_MBOX_CMD_REINIT = 3, CSPL_MBOX_CMD_STOP_PRE_REINIT = 4, CSPL_MBOX_CMD_HIBERNATE = 5, CSPL_MBOX_CMD_OUT_OF_HIBERNATE = 6, CSPL_MBOX_CMD_SPK_OUT_ENABLE = 7, CSPL_MBOX_CMD_UNKNOWN_CMD = -1, CSPL_MBOX_CMD_INVALID_SEQUENCE = -2, }; /* * IRQs */ #define CS35L41_IRQ(_irq, _name, _hand) \ { \ .irq = CS35L41_ ## _irq ## _IRQ,\ .name = _name, \ .handler = _hand, \ } struct cs35l41_irq { int irq; const char *name; irqreturn_t (*handler)(int irq, void *data); }; #define CS35L41_REG_IRQ(_reg, _irq) \ [CS35L41_ ## _irq ## _IRQ] = { \ .reg_offset = (CS35L41_ ## _reg) - CS35L41_IRQ1_STATUS1,\ .mask = CS35L41_ ## _irq ## _MASK \ } /* (0x0000E010) CS35L41_IRQ1_STATUS1 */ #define CS35L41_BST_OVP_ERR_SHIFT 6 #define CS35L41_BST_OVP_ERR_MASK BIT(CS35L41_BST_OVP_ERR_SHIFT) #define CS35L41_BST_DCM_UVP_ERR_SHIFT 7 #define CS35L41_BST_DCM_UVP_ERR_MASK BIT(CS35L41_BST_DCM_UVP_ERR_SHIFT) #define CS35L41_BST_SHORT_ERR_SHIFT 8 #define CS35L41_BST_SHORT_ERR_MASK BIT(CS35L41_BST_SHORT_ERR_SHIFT) #define CS35L41_TEMP_WARN_SHIFT 15 #define CS35L41_TEMP_WARN_MASK BIT(CS35L41_TEMP_WARN_SHIFT) #define CS35L41_TEMP_ERR_SHIFT 17 #define CS35L41_TEMP_ERR_MASK BIT(CS35L41_TEMP_ERR_SHIFT) #define CS35L41_AMP_SHORT_ERR_SHIFT 31 #define CS35L41_AMP_SHORT_ERR_MASK BIT(CS35L41_AMP_SHORT_ERR_SHIFT) enum cs35l41_irq_list { CS35L41_BST_OVP_ERR_IRQ, CS35L41_BST_DCM_UVP_ERR_IRQ, CS35L41_BST_SHORT_ERR_IRQ, CS35L41_TEMP_WARN_IRQ, CS35L41_TEMP_ERR_IRQ, CS35L41_AMP_SHORT_ERR_IRQ, CS35L41_NUM_IRQ }; extern struct regmap_config cs35l41_regmap_i2c; extern struct regmap_config cs35l41_regmap_spi; int cs35l41_test_key_unlock(struct device *dev, struct regmap *regmap); int cs35l41_test_key_lock(struct device *dev, struct regmap *regmap); int cs35l41_otp_unpack(struct device *dev, struct regmap *regmap); int cs35l41_register_errata_patch(struct device *dev, struct regmap *reg, unsigned int reg_revid); int cs35l41_set_channels(struct device *dev, struct regmap *reg, unsigned int tx_num, unsigned int *tx_slot, unsigned int rx_num, unsigned int *rx_slot); int cs35l41_gpio_config(struct regmap *regmap, struct cs35l41_hw_cfg *hw_cfg); void cs35l41_configure_cs_dsp(struct device *dev, struct regmap *reg, struct cs_dsp *dsp); int cs35l41_set_cspl_mbox_cmd(struct device *dev, struct regmap *regmap, enum cs35l41_cspl_mbox_cmd cmd); int cs35l41_write_fs_errata(struct device *dev, struct regmap *regmap); int cs35l41_enter_hibernate(struct device *dev, struct regmap *regmap, enum cs35l41_boost_type b_type); int cs35l41_exit_hibernate(struct device *dev, struct regmap *regmap); int cs35l41_init_boost(struct device *dev, struct regmap *regmap, struct cs35l41_hw_cfg *hw_cfg); bool cs35l41_safe_reset(struct regmap *regmap, enum cs35l41_boost_type b_type); int cs35l41_mdsync_up(struct regmap *regmap); int cs35l41_global_enable(struct device *dev, struct regmap *regmap, enum cs35l41_boost_type b_type, int enable, struct cs_dsp *dsp); #endif /* __CS35L41_H */